FETソース接地増幅回路の遮断周波数について
下のＵＲＬのような図９のソース接地増幅回路で入力容量Ｃｉ、ゲート・ソース間に存在する容量Ｃｇｓの値が分かりません。
http://www.marutsu.co.jp/user/fet_1-2.php
図が少し違うので説明すると、上ＵＲＬの図９にある抵抗ＲＬはなく、またＶｃｃと抵抗ＲＤの交わってるノードから右にコンデンサＣ４、Ｃ５が下に書いた図のようになってます。図９の右上のところです（見難いと思いますがスミマセン）
ＶｃｃとＲＤの交わっているノード→・---・-----・
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,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,Ｃ4＝,,,,C5＝
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,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,,GND,,,,,,GND
（※半角の点の列は空欄埋めのやり方が分からないので書いてあります）
上ＵＲＬにある図９と上の説明を足してあるのが回路図です。
そこでこの回路の遮断周波数を求めたいのですが
低域遮断周波数 ｆＬ＝１/２πＣｉ・Ｒｉ （Ｃｉ：入力容量、Ri：入力抵抗）
高域遮断周波数 ｆＨ＝１/２πＣｇｓ・Ｒｉ （Ｃｇｓ：ゲート・ソース間に存在する容量）
入力抵抗ＲｉはR1とR2の並列合成と分かったのですが、入力容量Ci とゲート・ソース間の容量Cgs の値がどう導き出すのかわかりません。
できれば、導出過程と値を教えて欲しいです。
詳しい容量や抵抗の値は
Ｃ１=10μＦ、 Ｃ2=100μＦ、 Ｃ3=10μＦ、 C4=0.1μF, C5=10μF
Vi=15V, Vcc=15V, R1=150kΩ, R2=10kΩ、 Rs=1kΩ、 RD=6.2kΩ となっています。
よろしくお願いします。
補足
補足での画像が載せられなかったので新しくページを質問しなおしました。 http://okwave.jp/qa/q7957206.html お願いします